테라박스 1000S 1U FPGA 서버
FPGA Server TeraBox 1000S Low-cost 1U Server for FPGA Cards Including Front Panel Access Overview Looking for an economical 1U server for a single FPGA
BittWare Partner IP Core
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100Gbps에서 낮은 대기 시간 RoCE v2
GROVF RDMA IP 코어 및 호스트 드라이버는 RDMA over Converged Ethernet(RoCE v2) 시스템 구현 및 표준 동사 API와의 통합을 제공합니다. RDMA IP는 IP 서브시스템 자체, 100G MAC IP 서브시스템, DMA 서브시스템, 호스트 드라이버 및 소프트웨어의 예제 애플리케이션을 포함하는 참조 설계와 함께 제공됩니다. 시스템 드라이버는 OFED 표준 동사 API와 통합되며 잘 알려진 RNIC 카드 및 소프트웨어와 호환됩니다. 또한 IP 코어는 100Gbps 처리량에서 RoCE v2의 짧은 지연 시간 FPGA 구현을 제공합니다.
주요 기능
RNIC 및 소프트 RoCE v2와 호환 가능
100Gb/s throughput, 2µs latency
1023 이상 구성 RDMA 큐 쌍
기능
- 하드웨어 운영 RC, XRC, RD, UC, UD 서비스
- 수신 및 발신 전송, RDMA 읽기, RDMA 쓰기
- FPGA 및 ECN에 구현된 메모리 보호 도메인
- 제3자 MAC 및 DMA IP
- 호스트 컴퓨터의 표준 동사 API
- 동사 API를 사용한 동적 구성
- 하드웨어 재전송 및 순서 변경
- 사용자 지정 가능한 IP
FPGA 기반 SmartNIC를 사용하여 RNIC 사용 사례 사용 가능
블록 다이어그램, 데이터 시트 및 제품 세부 정보
제품 운영
이 솔루션은 컨버지드 이더넷 프로토콜을 통해 RDMA를 구현하는 소프트 IP입니다. MAC 및 DMA와 통합된 FPGA IP와 호스트 CPU 드라이버로 구성됩니다. IP는 Xilinx UltraScale+ FPGA를 특징으로 하는 BittWare의 XUP-VV8 및 XUP-P3R FPGA 카드와 호환됩니다. 이 솔루션은 IB 사양에 명시된 채널 어댑터 및 RoCE v2 요구 사항을 준수합니다. 1페이지의 다이어그램은 시스템의 단순한 아키텍처 개요를 보여줍니다. 데이터 플레인과 안정적인 통신은 하드웨어 오프로드이며 구현에는 FPGA에 CPU 코어가 포함되지 않습니다.
자세한 기능 목록
- 알려진 RNIC 제품 및 소프트 RoCE 구현(RoCE v2)과 완벽하게 호환 가능
- Under 2.0 µs software to software latency (roundtrip) and under 300 ns hardware to hardware latency (roundtrip)
- 100Gb/s 처리량
- 구성 가능한 RDMA 큐 쌍
- 1023 이상
- 하드웨어 재전송 관리
- FPGA에서 구현된 메모리 보호 도메인
- ECN, PFC를 이용한 혼잡 제어
- 제 3 자 MAC 및 DMA IP와 함께 작동 할 수 있습니다.
- 동사 API를 사용한 동적 구성
- 호스트 머신 사용자 / 커널 공간의 표준 동사 API
- 하드웨어 구현 RC(신뢰할 수 있는 연결), 확장 신뢰할 수 있는 연결(XRC), 신뢰할 수 있는 데이터그램(RD), 신뢰할 수 없는 연결(UC) 및 신뢰할 수 없는 데이터그램(UD)
- 수신 및 발신 전송, RDMA 읽기, RDMA 쓰기(RDMA 원자는 지원되지 않음)
참조 설계
참조 예제는 다음 세 부분으로 구성됩니다.
- RDMA 프로토콜을 구현하는 참조 설계로 암호화된 FPGA IP
- FPGA 기반 RDMA 어댑터에 대한 표준 동사 API 지원을 제공하는 소프트웨어 드라이버
- 탁구 테스트 결과를 보여주는 Verbs API 위에 빌드된 예제 응용 프로그램: 대기 시간 및 대역폭
샘플 구현 결과
| 장치 | 루트 | 온칩 메모리 |
|---|---|---|
| 울트라스케일+ VU9P | 110K | 15메가바이트 |
호환 가능한 FPGA 카드
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