
使用網路示例比較 FPGA RTL 與 HLS C/C++
白皮書 使用網路示例比較 FPGA RTL 與 HLS C/C++ 概述 大多數 FPGA 程式師認為,高級工具總是發出更大的比特流,因為
GROVF RDMA IP 核和主機驅動程式提供基於融合乙太網的 RDMA (RoCE v2) 系統實現以及與標準動詞 API 的整合。RDMA IP 隨參考設計一起提供,其中包括IP子系統本身、100G MAC IP子系統、DMA 子系統、主機驅動程式和軟體上的範例應用程式。系統驅動程式與 OFED 標準動詞 API 集成,並與著名的 RNIC 卡和軟體相容。該IP核還提供RoCE v2的低延遲 FPGA 實現,輸送量為100 Gbps。
The solution is a soft IP implementing RDMA over Converged Ethernet protocol. It consists of FPGA IP integrated with MAC and DMA, plus the host CPU drivers and is compatible with a variety of BittWare’s FPGA cards. The 200Gbps IP is compatible with BittWare’s IA-440i Agilex 7 I-Series FPGA card, and the 100Gbps IP is compatible with BittWare’s IA-840f and IA-420f Agilex 7 F-series cards and XUP-VV8 and XUP-P3R UltraScale+ FPGA cards. The solution complies with Channel Adapter and RoCE v2 requirements as stated in the IB specification. The diagram on page 1 shows a simplistic architectural overview of the system. The data plane and reliable communication is hardware offloaded and the implementation does not include CPU cores in the FPGA.
參考範例由三部分組成:
裝置 | LUT | 片上記憶體 |
---|---|---|
UltraScale+ VU9P | 170K | 6兆位元組 |
Agilex 7 AGF014 | 170K | 6兆位元組 |
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