
來自原子規則的時間伺服IP核
BittWare合作夥伴IP TimeServo IP核心高性能系統定時器IP 原子規則的TimeServo IP內核是一個RTL IP內核,用於
FPGA 為各種 HPC 應用提供 高性能、工作負載 靈活性 和高 能效 操作。
近年來,面向 HPC 的 FPGA 價值主張 得到了顯著加強。
這些是BWNN白皮書中展示的關鍵優勢:
FPGA 與 CPU 配合使用,是異構計算方法的一部分。對於某些工作負載,FPGA 提供了比 CPU 顯著的加速,在這種情況下,機器學習推理的速度提高了 50 倍。
FPGA 具有一系列工具,可針對應用進行最佳定製。硬體結構適應僅使用所需的內容,包括在需要時使用強化浮點塊。對於BWNN的權重,我們只使用了一個比特,加上平均比例因數,仍然達到了可接受的精度,但節省了大量資源。
每瓦功率不僅在邊緣很重要,而且在數據中心的空間和電力成本方面的功率預算中也很重要。FPGA 可以獨特地提供最新的高效庫,但每瓦功耗遠低於 CPU。
借助BittWare獨家優化的 OpenCL BSP,您可以利用面向軟體的開發人員和最新的軟體庫。這使我們能夠快速調整 YOLOv3 框架,該框架比舊的 ML 庫提高了性能。
當處理存儲的需求 超過 具有 CPU 的傳統架構時,我們針對應用程式。
FPGA 允許客戶建立具有以下特性的特定於應用的硬體實現:
從我們的技術人員那裡獲取您的 HPC 問題的答案。
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