PCIe FPGA 카드

S7t-VG6

벡터패스 액셀러레이터 카드

GDDR6 및 QSFP-DD를 갖춘 Achronix Speedster7t FPGA 보드

S7t-VG6 PCIe 카드 사진

개요

S7t-VG6 벡터패스 가속기 카드는 고속 네트워킹과 빠른 고용량 메모리 액세스에 최적화된 7nm Achronix FPGA를 제공합니다. QSFP-DD(이중 밀도) 케이지가 특징인 이 보드는 56G PAM4 지원 Speedster®7t 장치를 사용하여 최대 1x 400GbE 또는 4x 100GbE를 지원합니다. 추가 QSFP 포트는 2개의 100GbE와 확장을 위한 4개의 MCIO 커넥터를 지원합니다. 16개 채널의 GDDR6 그래픽 DRAM은 최대 448GB/s의 고대역폭 메모리 요구 사항을 처리합니다.

FPGA는 최대 692K 6입력 룩업 테이블(LUT)과 189Mb 임베디드 RAM 등 대규모 로직 및 메모리 리소스를 제공합니다. 또한 2,560개의 MLP(머신 러닝 블록)를 제공합니다.

주요 기능

400G 1개 또는 100G 6개용 QSFP

16GB GDDR6 최대 448GB/s

56Gbps SERDES를 지원하는 7nm FPGA

비디오

크레이그 페트리가 카드의 주요 기능에 대해 자세히 설명합니다.

PCI Express 로고

5.0 세대

대역폭을 두 배로 늘리세요!

S7t-VG6는 Gen4보다 레인당 두 배의 대역폭을 제공하는 Gen5를 지원합니다.

블록 다이어그램, 데이터 시트 및 사양

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사양

FPGA

  • 아크로닉스 스피드스터 AC7t1500
    • 52.5 x52.5 패키지
    • 692K 6입력 룩업 테이블(LUT)
    • 189Mb 임베디드 RAM
    • 2,560 MLP

온보드 메모리

  • 16GBytes GDDR6: 8뱅크(뱅크당 독립적인 16비트, 14Gbps 채널 2개), 3.5Tbps 총 대역폭
  • 1뱅크 DDR4-2666(ECC 포함), 최대 4GByt(x72)
  • FPGA 부팅용 플래시 메모리

호스트 인터페이스

  • PCIe Gen5 x16 호스트 인터페이스 지원을 위한 PCI-SIG 인증 획득

외부 클록킹

  • 1 PPS 및 10MHz 레퍼런스 클럭 전면 패널 입력

USB

  • BMC, USB-JTAG, USB-UART에 액세스하기 위한 USB 포트
  • 데이지 체인용 두 번째 USB 포트

MCIO

  • 4개의 트랜시버를 통해 FPGA에 연결된 MCIO
  • PCIe Gen5 하드 IP

GPIO

  • 8개의 GPIO 핀, 3.3V, 싱글 엔드, 방향(Tx, Rx)은 GPIO당 FPGA에서 독립적으로 설정 가능, 버퍼 정격 200Mbps

QSFP 케이지

  • 전면 패널의 QSFP-DD 케이지
    • 56G PAM4 트랜시버
    • 400/200/100/50/25/10GbE
    • 하드 MAC 및 FEC
  • 전면 패널의 QSFP56 케이지
    • 56G PAM4 트랜시버
    • 200/100/50/25/10GbE
    • 하드 MAC 및 FEC

보드 관리 컨트롤러

  • 전압, 전류, 온도 모니터링
  • 전원 시퀀싱 및 재설정
  • 현장 업그레이드
  • FPGA 구성 및 제어
  • 시계 구성
  • I2C 버스 액세스
  • USB 2.0
  • 전압 재정의

냉각

  • 표준: 이중 폭 패시브 방열판
  • 옵션: 이중 폭 액티브 방열판
  • 옵션: 이중 폭 액체 냉각

전기

  • 2개의 AUX 커넥터(8핀)를 통한 온보드 전원 공급
  • 전력 손실은 애플리케이션에 따라 다릅니다.
  • 일반적인 최대 전력 소비량 미정

환경

  • 작동 온도 5°C ~ 35°C
  • 에어플로우 요구 사항: BittWare에 문의하기

폼 팩터

  • 표준 높이의 PCIe 이중 폭 보드
  • 크기: 111.15mm x 266.70mm(4.376인치 x 10.500인치)

개발 도구

시스템 개발

  • PCIe 드라이버, 라이브러리 및 보드 모니터링 유틸리티를 포함한 소프트웨어 개발 툴킷

FPGA 개발

  • Achronix 도구 -ACE 설계 도구
  • FPGA 예제 프로젝트

r4 v0

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