IA-440i
400G + PCIe Gen5单宽卡
具有Agilex功能的紧凑型400G卡
英特尔Agilex 7 I系列FPGA针对带宽密集型和需要高性能处理器接口的应用进行了优化。
- 第二代HyperFlex架构：与Stratix 10 FPGA相比，性能提高40%或总功率降低40% 。
- 400G：可配置的网络支持，满足最苛刻的带宽要求。
- 支持PCIe Gen5和CXL：数据传输速度比Gen4快2倍，以及CPU和工作负载加速器之间的高速接口。
Agilex加速视频
400G网络
IA-440i提供高达400G的带宽，支持最苛刻的带宽要求。可配置的网络支持包括硬以太网媒体访问控制（MAC）、物理编码子层（PCS）和前向纠错（FEC），适用于各种速度。
第二代英特尔® Hyperflex™架构
与Stratix 10器件设计相比，英特尔Hyperflex的持续改进带来了性能的提高。因此，第二代架构大大提高了客户的生产力，缩短了上市时间。
PCIe Gen5和CXL
PCIe Gen5支持比PCIe Gen4高2倍的数据传输速度，为PC互连、图形适配器和芯片级通信的开发者提供了更大的性能能力。而对Compute Express Link（CXL）的支持实现了与CPU的高速、低延迟的接口。
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第5.0代
双倍的带宽!
IA-440i采用最新的PCIe Gen5接口，其传输带宽是Gen4设备的两倍。
企业级的部署
借助Molex的力量，将产品推向市场
IA-440i建立在BittWare的企业级基石上：现有的产品和流程已经通过广泛的验证得到证实。当需要投入生产时，这意味着更快的周转和利用你一直用于开发的相同硬件。
支持 CXL
CXL（Compute Express Link）是业界支持的处理器、内存扩展和加速器之间的高速缓存一致性互连。CXL 技术可保持 CPU 内存空间与附加设备内存之间的内存一致性，从而以更低的延迟实现资源共享，降低软件堆栈复杂性，并降低整体系统成本。
* CXL需要许可，该许可与卡分开销售。
利用BittWare合作伙伴的IP和解决方案更快地进入市场
IA-440i方框图、数据表和规格
要访问 USB 和/或 JTAG，需要使用附件电缆。请从以下选项中选择：
- USB 专用辫子线：Pico-lock 至 USB A 电缆，BittWare 零件编号RS-PL12-UAP-83。
- 仅 JTAG 的辫子电缆：Pico-lock 至 JTAG 电缆，BittWare 零件编号RS-PL12-JTB-13
- USB + JTAG 突破卡: BittWare 零件编号 acc-ia-jtusb-bko
我们推荐使用 USB + JTAG 组合辫子卡进行开发。部署时，建议使用纯 USB 的辫子线。
这些附件电缆单独出售。
董事会规格
FPGA
- 英特尔Agilex 7 AGI023
- AGI023：核心速度等级为-1：XCVR速度等级-1
- XCVR速度等级-1支持CXL（CXL IP需要许可并单独购买）。
- FPGA包括ARM HPS
车载闪光灯
- 2Gbit闪存用于启动FPGA
外部存储器
- 2x 组板载 DDR4，每组 8GB
主机接口
- 直接到FPGA的x16 Gen5接口，与PCIe硬IP相连
- 支持 CXL（CXL IP 需获得许可并单独购买）
QSFP-DD笼子
- 400 Gbps (8x 50Gbps PAM4)
- PAM4: 1x 400GbE, 2x 200GbE, 4x 100GbE, 8x 50GbE
- NRZ: 1x 200GbE, 2x 100GbE, 4x 50GbE, 8x 10/25 GbE
- 多速率硬MAC支持所有组合
- 用于网络恢复时钟的抖动清除器
外部时钟
- 1 PPS和10MHz参考时钟输入（板载）。
USB
- USB访问BMC，USB-UART
董事会管理主计长
- 电源排序和复位
- 电压、电流、温度监测
- 保护关闭
- 时钟配置
- 带SPI链接的低带宽BMC-FPGA通信
- USB 2.0
- 支持PLDM
- 卡片级安全
- BMC的信任根基
- BMC和FPGA安全启动
- BMC和FPGA安全升级
- 关键管理
冷却
- 标准：单宽被动式散热器
电气
- 来自PCIe插槽的板载电源
- 功率耗散取决于应用
- 最大功率消耗75W
环境
- 操作温度：5°C至35°C
质量
- 制造符合IPC-A-610第2级标准
- 符合RoHS标准
- CE、FCC、UKCA和ICES认证
形状系数
- 低矮（半高半长）的PCIe插槽卡
- 尺寸：68.90mm x 167.65mm (2.713in x 6.600in)
开发工具
系统开发
- BittWare SDK包括PCIe驱动、库和板卡监控实用程序
应用开发
- 支持的设计流程 - Quartus Prime Pro（HDL、Verilog、VHDL 等）
r1 v0
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