
Aufbau des Packet Parsers von BittWare, HLS vs. P4-Implementierungen
White Paper Building BittWare's Packet Parser, HLS vs. P4 Implementierungen Übersicht Eine der Funktionen von BittWare's SmartNIC Shell und BittWare's Loopback Example ist
Der GROVF RDMA IP-Kern und die Host-Treiber bieten RDMA over Converged Ethernet (RoCE v2) Systemimplementierung und Integration mit Standard Verbs API. Die RDMA-IP wird mit einem Referenzdesign geliefert, das das IP-Subsystem selbst, das 100G-MAC-IP-Subsystem, das DMA-Subsystem, Host-Treiber und eine Beispielanwendung in Software enthält. Die Systemtreiber sind mit der OFED-Standard-Verbs-API integriert und sind mit bekannten RNIC-Karten und -Software kompatibel. Der IP-Kern bietet außerdem eine FPGA-Implementierung von RoCE v2 mit niedriger Latenz und einem Durchsatz von 100 Gbit/s.
Die Lösung ist eine Soft-IP, die das Protokoll RDMA over Converged Ethernet implementiert. Sie besteht aus einer FPGA-IP, die mit MAC und DMA integriert ist, sowie den Host-CPU-Treibern. Die IP ist kompatibel mit BittWare's IA-420f FPGA Karten* mit Intel Agilex 7 und mit XUP-VV8 und XUP-P3R FPGA Karten mit AMD/Xilinx UltraScale+. Die Lösung entspricht den Anforderungen für Channel Adapter und RoCE v2 gemäß der IB-Spezifikation. Das Diagramm auf Seite 1 zeigt einen vereinfachten Überblick über die Architektur des Systems. Die Datenebene und die zuverlässige Kommunikation sind hardwaremäßig ausgelagert, und die Implementierung enthält keine CPU-Cores im FPGA.
*IA-840f-Unterstützung bald verfügbar.
Das Referenzbeispiel besteht aus drei Teilen:
Gerät | LUTs | On-Chip-Speicher |
---|---|---|
UltraScale+ VU9P | 110K | 15Mb |
Unser technisches Vertriebsteam steht bereit, um Ihnen Informationen zur Verfügbarkeit und Konfiguration zu geben oder Ihre technischen Fragen zu beantworten.
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