Aufbau von NVMe über Fabrics
White Paper Building NVMe Over Fabrics with BittWare FPGA Solutions Overview Since the introduction of the Non-Volatile Memory Express (or NVMe) protocol, data center customers
Wann sind FPGAs für die Netzwerkbeschleunigung geeignet?
Viele wichtige Netzwerkfunktionen hängen heute von FPGA-basierter Hardwarebeschleunigung ab. Im Allgemeinen lassen sich solche Funktionen in eine von vier Kategorien einordnen:
Funktionen entwickeln sich zu schnell für ASIC-Lösungen
Meistens im Sicherheitsbereich: Anti-DDoS zum Beispiel. Auch im Hochfrequenzhandel (HFT/Fintech), wo sich die Algos der Wettbewerber regelmäßig ändern.
Funktionen, die zu neu sind, um in ASIC gehärtet zu werden
ASICs sind zu teuer, um sie für Anwendungen mit geringen Stückzahlen zu rechtfertigen. Die ersten marktreifen Geschwindigkeiten wie 56G PAM4, die 400G ermöglichen, sind zuerst auf FPGAs verfügbar.
Zu spezialisiert, um eine ASIC-Implementierung zu rechtfertigen
Dies zeigt sich bei der Paketerfassung und -filterung in Echtzeit für Lawful Intercept (LI) und bei Funktionstests von Geräten mit hohen Leitungsgeschwindigkeiten von über 100 Gbps.
Schnell aufkommende proprietäre Funktionen, die zuvor auf CPUs liefen
CPUs haben Schwierigkeiten bei der Bewältigung von Netzwerkaufgaben wie DPI über 10 GbE, wodurch ein Bedarf an Offload bei 40+ GbE-Raten entsteht. Die Einführung einer FPGA-basierten Lösung ist eine Herausforderung, weshalb wir Referenzdesigns und Dienstleistungen zur Verfügung stellen.
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